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<?xml version="1.0" encoding="UTF-8" standalone="no"?>
<project source="3.4.1" version="1.0">
This file is intended to be loaded by Logisim-evolution (https://github.com/reds-heig/logisim-evolution).
<lib desc="#Wiring" name="0">
<tool name="Splitter">
<a name="appear" val="center"/>
<a name="facing" val="south"/>
</tool>
<tool name="Pin">
<a name="facing" val="north"/>
</tool>
<tool name="Probe">
<a name="facing" val="north"/>
</tool>
<tool name="Tunnel">
<a name="facing" val="east"/>
</tool>
<tool name="Pull Resistor">
<a name="facing" val="north"/>
</tool>
<tool name="Clock">
<a name="facing" val="north"/>
</tool>
<tool name="Constant">
<a name="facing" val="west"/>
<a name="value" val="0x0"/>
</tool>
</lib>
<lib desc="#Gates" name="1">
<tool name="PLA">
<a name="table" val=""/>
</tool>
</lib>
<lib desc="#Plexers" name="2">
<tool name="Multiplexer">
<a name="enable" val="false"/>
</tool>
<tool name="Demultiplexer">
<a name="enable" val="false"/>
</tool>
</lib>
<lib desc="#Arithmetic" name="3"/>
<lib desc="#Memory" name="4">
<tool name="D Flip-Flop">
<a name="appearance" val="logisim_evolution"/>
</tool>
<tool name="T Flip-Flop">
<a name="appearance" val="logisim_evolution"/>
</tool>
<tool name="J-K Flip-Flop">
<a name="appearance" val="logisim_evolution"/>
</tool>
<tool name="S-R Flip-Flop">
<a name="appearance" val="logisim_evolution"/>
</tool>
<tool name="Register">
<a name="appearance" val="logisim_evolution"/>
</tool>
<tool name="Counter">
<a name="appearance" val="logisim_evolution"/>
</tool>
<tool name="Shift Register">
<a name="appearance" val="logisim_evolution"/>
</tool>
<tool name="Random">
<a name="appearance" val="logisim_evolution"/>
</tool>
<tool name="RAM">
<a name="appearance" val="logisim_evolution"/>
</tool>
<tool name="ROM">
<a name="appearance" val="logisim_evolution"/>
<a name="contents">addr/data: 8 8
0
</a>
</tool>
</lib>
<lib desc="#I/O" name="5"/>
<lib desc="#TTL" name="6"/>
<lib desc="#TCL" name="7">
<tool name="TclGeneric">
<a name="content">library ieee;
use ieee.std_logic_1164.all;
entity TCL_Generic is
port(
--Insert input ports below
horloge_i : in std_logic; -- input bit example
val_i : in std_logic_vector(3 downto 0); -- input vector example
--Insert output ports below
max_o : out std_logic; -- output bit example
cpt_o : out std_logic_Vector(3 downto 0) -- output vector example
);
end TCL_Generic;
</a>
</tool>
</lib>
<lib desc="#Base" name="8">
<tool name="Text Tool">
<a name="font" val="SansSerif plain 12"/>
<a name="halign" val="center"/>
<a name="text" val=""/>
<a name="valign" val="base"/>
</tool>
</lib>
<lib desc="#BFH-Praktika" name="9"/>
<lib desc="#Input/Output-Extra" name="10"/>
<lib desc="#Soc" name="11">
<tool name="Rv32im">
<a name="SocBusSelection" val=""/>
</tool>
<tool name="Nios2">
<a name="SocBusSelection" val=""/>
</tool>
<tool name="SocBus">
<a name="SocBusIdentifier" val="0x00000179DB22385F7d1112b1"/>
</tool>
<tool name="Socmem">
<a name="SocBusSelection" val=""/>
</tool>
<tool name="SocPio">
<a name="SocBusSelection" val=""/>
</tool>
<tool name="SocVga">
<a name="SocBusSelection" val=""/>
</tool>
<tool name="SocJtagUart">
<a name="SocBusSelection" val=""/>
</tool>
</lib>
<lib desc="file#logi7400ic.circ" name="12"/>
<main name="CLOCKS"/>
<options>
<a name="gateUndefined" val="ignore"/>
<a name="simlimit" val="1000"/>
<a name="simrand" val="0"/>
</options>
<mappings>
<tool lib="8" map="Button2" name="Menu Tool"/>
<tool lib="8" map="Button3" name="Menu Tool"/>
<tool lib="8" map="Ctrl Button1" name="Menu Tool"/>
</mappings>
<toolbar>
<tool lib="8" name="Poke Tool"/>
<tool lib="8" name="Edit Tool"/>
<tool lib="8" name="Wiring Tool"/>
<tool lib="8" name="Text Tool">
<a name="font" val="SansSerif plain 12"/>
<a name="halign" val="center"/>
<a name="text" val=""/>
<a name="valign" val="base"/>
</tool>
<sep/>
<tool lib="0" name="Pin">
<a name="appearance" val="NewPins"/>
</tool>
<tool lib="0" name="Pin">
<a name="appearance" val="NewPins"/>
<a name="facing" val="west"/>
<a name="output" val="true"/>
</tool>
<sep/>
<tool lib="1" name="NOT Gate"/>
<tool lib="1" name="AND Gate"/>
<tool lib="1" name="OR Gate"/>
<tool lib="1" name="XOR Gate"/>
<tool lib="1" name="NAND Gate"/>
<tool lib="1" name="NOR Gate"/>
<sep/>
<tool lib="4" name="D Flip-Flop">
<a name="appearance" val="logisim_evolution"/>
</tool>
<tool lib="4" name="Register">
<a name="appearance" val="logisim_evolution"/>
</tool>
</toolbar>
<circuit name="CLOCKS">
<a name="appearance" val="logisim_evolution"/>
<a name="circuit" val="CLOCKS"/>
<a name="circuitnamedboxfixedsize" val="true"/>
<a name="circuitvhdlpath" val=""/>
<a name="clabel" val=""/>
<a name="clabelfont" val="SansSerif bold 16"/>
<a name="clabelup" val="east"/>
<comp lib="0" loc="(1060,450)" name="Pin">
<a name="appearance" val="NewPins"/>
<a name="facing" val="west"/>
<a name="label" val="nRESET"/>
<a name="output" val="true"/>
</comp>
<comp lib="0" loc="(1560,120)" name="Pin">
<a name="appearance" val="NewPins"/>
<a name="facing" val="west"/>
<a name="label" val="IOCLK"/>
<a name="output" val="true"/>
</comp>
<comp lib="0" loc="(1560,300)" name="Pin">
<a name="appearance" val="NewPins"/>
<a name="facing" val="west"/>
<a name="label" val="CLKM"/>
<a name="output" val="true"/>
</comp>
<comp lib="0" loc="(1560,410)" name="Pin">
<a name="appearance" val="NewPins"/>
<a name="facing" val="west"/>
<a name="label" val="CLKS"/>
<a name="output" val="true"/>
</comp>
<comp lib="0" loc="(250,210)" name="Clock">
<a name="label" val="TURBO_CLK"/>
</comp>
<comp lib="0" loc="(250,240)" name="Clock">
<a name="label" val="NORMAL_CLK"/>
</comp>
<comp lib="0" loc="(250,270)" name="Clock">
<a name="label" val="SLOW_CLK"/>
</comp>
<comp lib="0" loc="(260,300)" name="Pin">
<a name="appearance" val="NewPins"/>
<a name="label" val="MANUAL_CLK"/>
</comp>
<comp lib="0" loc="(410,90)" name="Pin">
<a name="appearance" val="NewPins"/>
<a name="label" val="nHALT"/>
</comp>
<comp lib="0" loc="(420,130)" name="Pin">
<a name="appearance" val="NewPins"/>
<a name="label" val="CLOCK_SELECT"/>
<a name="width" val="2"/>
</comp>
<comp lib="0" loc="(420,380)" name="Pin">
<a name="appearance" val="NewPins"/>
<a name="label" val="nSTOP_CLK"/>
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<comp lib="0" loc="(420,420)" name="Pin">
<a name="appearance" val="NewPins"/>
<a name="label" val="nBP_RESET"/>
</comp>
<comp lib="0" loc="(440,300)" name="Ground"/>
<comp lib="0" loc="(490,140)" name="Splitter">
<a name="appear" val="center"/>
<a name="bit0" val="1"/>
<a name="bit1" val="0"/>
<a name="facing" val="south"/>
</comp>
<comp lib="0" loc="(490,290)" name="Ground"/>
<comp lib="0" loc="(580,320)" name="Pin">
<a name="appearance" val="NewPins"/>
<a name="label" val="nWAIT"/>
</comp>
<comp lib="0" loc="(870,190)" name="Power"/>
<comp lib="0" loc="(870,310)" name="Power"/>
<comp lib="0" loc="(870,490)" name="Power"/>
<comp lib="0" loc="(870,610)" name="Power"/>
<comp lib="0" loc="(900,240)" name="NoConnect"/>
<comp lib="0" loc="(900,320)" name="NoConnect"/>
<comp lib="0" loc="(900,500)" name="NoConnect"/>
<comp lib="0" loc="(980,330)" name="Ground"/>
<comp lib="1" loc="(1080,490)" name="NOT Gate"/>
<comp lib="1" loc="(1350,360)" name="AND Gate">
<a name="facing" val="west"/>
</comp>
<comp lib="1" loc="(1350,470)" name="AND Gate">
<a name="facing" val="west"/>
</comp>
<comp lib="1" loc="(1580,180)" name="AND Gate">
<a name="inputs" val="3"/>
</comp>
<comp lib="1" loc="(1580,240)" name="AND Gate"/>
<comp lib="1" loc="(1670,210)" name="OR Gate"/>
<comp lib="1" loc="(480,90)" name="NOT Gate"/>
<comp lib="1" loc="(570,400)" name="AND Gate">
<a name="label" val="U4B"/>
</comp>
<comp lib="1" loc="(700,480)" name="NOT Gate">
<a name="label" val="U20A"/>
</comp>
<comp lib="1" loc="(790,360)" name="AND Gate">
<a name="label" val="U4C"/>
</comp>
<comp lib="1" loc="(960,450)" name="Buffer"/>
<comp lib="1" loc="(970,180)" name="AND Gate">
<a name="label" val="U4A"/>
</comp>
<comp lib="10" loc="(1320,610)" name="Digital Oscilloscope">
<a name="frontlines" val="falling"/>
<a name="inputs" val="7"/>
</comp>
<comp lib="12" loc="(520,210)" name="IC_74151">
<a name="label" val="U2"/>
<a name="labelloc" val="east"/>
</comp>
<comp lib="12" loc="(890,200)" name="IC_7474">
<a name="label" val="U3"/>
<a name="labelloc" val="west"/>
</comp>
<comp lib="12" loc="(890,500)" name="IC_7474"/>
<comp lib="2" loc="(1050,190)" name="Multiplexer">
<a name="enable" val="false"/>
</comp>
<comp lib="4" loc="(1320,190)" name="D Flip-Flop">
<a name="appearance" val="classic"/>
</comp>
<comp lib="4" loc="(1320,300)" name="D Flip-Flop">
<a name="appearance" val="classic"/>
</comp>
<comp lib="4" loc="(1320,410)" name="D Flip-Flop">
<a name="appearance" val="classic"/>
</comp>
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